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Slave Port Interface
8.4
Slave memory map/register definitions
specifies the module memory map. Details of each register are provided in the following section.
8.4.1
Slave memory map
Table 8-5. SLAVE memory map
Offset
address
0x00
0x20
0x22
0x23
0x24
0x25
0x26
0x27
0x28
0x29
0x2A
0x2B
0x2C
0x2E
Register
Slave Port Mailbox Register n (SP_MB n )
Slave Port Binary Semaphore (Mutex) Register n
(SP_MUTEX n )
Slave Port I 2 C Address Register (SP_ADDR)
Slave Port Status and Control Register (SP_SCR)
Slave Port Write Status Register 0 (SP_WSTS0)
Slave Port Write Status Register 1 (SP_WSTS1)
Slave Port Write Status Register 2 (SP_WSTS2)
Slave Port Write Status Register 3 (SP_WSTS3)
Slave Port Read Status Register 0 (SP_RSTS0)
Slave Port Read Status Register 1 (SP_RSTS1)
Slave Port Read Status Register 2 (SP_RSTS2)
Slave Port Read Status Register 3 (SP_RSTS3)
Slave Port Mutext Timeout Register n (SP_MTOR n )
Slave Port Output Interrupt Control Register (SP_OIC)
Access
Read/Write
Read/Write
Read/Write
Read/Write
Read
Read
Read
Read
Read
Read
Read
Read
Read/Write
Read/Write
Reset
0x00
0x00
0x23
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
0x00
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Details
MMA955xL Intelligent, Motion-Sensing Platform Hardware Reference Manual, Rev. 1.0
124
Freescale Semiconductor, Inc.
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